対象デバイス |
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NB85E,V831/2,VR5432,VR4122*1 |
エミュレーション機能 |
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CPU動作周波数 |
対象プロセッサに依存(KIT-xxxx-TP参照) |
インターフェース |
JTAG/N-Wire |
JTAG-CLK*2 |
100K - 25MHz |
ブレーク機能 |
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H/Wブレークポイント(実行アドレス) |
対象プロセッサに依存(KIT-xxxx-TP参照) |
S/Wブレークポイント |
100 |
アクセスイベントによるブレーク設定 |
対象プロセッサに依存(KIT-xxxx-TP参照) |
ステップブレーク |
可 |
マニュアルブレーク |
可 |
外部信号によるブレーク*2 |
対象プロセッサに依存(KIT-xxxx-TP参照) |
トレース機能 |
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トレースデータバス幅 |
4bit |
トレースメモリ容量 |
128K-word |
トレースクロック周波数*2 |
77MHz(max) |
トレースディレイサイクル数 |
0 - 1FFFFh |
タイムタグ(時間計測)*2 |
100nS - 30h |
実行アドレスによるトリガ設定 |
対象プロセッサに依存(KIT-xxxx-TP参照) |
データアクセスによるトリガ設定*2 |
対象プロセッサに依存(KIT-xxxx-TP参照) |
外部信号の取り込みとトリガ設定 |
可 |
実行アドレスによる開始・終了設定 |
対象プロセッサに依存(KIT-xxxx-TP参照) |
データトレース条件 |
対象プロセッサに依存(KIT-xxxx-TP参照) |
逆アセンブルトレース表示 |
可 |
ROMエミュレーション機能 |
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メモリ容量*2 |
8M - 32MByte |
アクセスタイム*2 |
40nS(バーストサイクル:35nS)*3 |
動作電圧*2 |
1.8V - 5V*3 |
電気的条件*2 |
LV-TTL,5Vトレラント*4 |
エミュレーション可能なROM数 |
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DIP-32pin-ROM(8bit-ROM) |
4(max) |
DIP-40/42pin-ROM(16bit-ROM) |
2(max) |
拡張16bit-標準ROMコネクタ |
2(max) |
エミュレーション可能なROMの容量(bit) |
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DIP-32pin-ROM(8bit-bus) |
1M,2M,4M,8M(27C010/020/040/080) |
DIP-40pin-ROM(16bit-bus) |
1M,2M,4M(27C1024/2048/4096) |
DIP-42pin-ROM(16bit-bus) |
8M,16M(27C8000/16000) |
拡張16bit-標準ROM(16bit-bus)*2 |
1M,2M,4M,8M,16M,32M,64M,128M,256M |
バス幅指定(bit) |
8/16/32 |
端子マスク機能 |
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対象プロセッサに依存(KIT-xxxx-TP参照) |